1、PAS：縮短設計閉環的先鋒技術
物理感知合成（PAS）將物理設計信息（如佈局、連線、擁塞、功耗）提前納入 RTL 合成階段，使合成結果與後端佈局更一致，從而減少反覆迭代，提升設計效率與 PPA（性能-功耗-面積）表現。

2、核心技術亮點與典型案例
I. 時序驅動綜合（Timing-Driven Synthesis）
結合 Cadence Innovus 工具進行物理信息驅動的佈局與優化，大幅縮短合成運行時間，並在 7nm 節點實現更穩定的時序閉環效率提升。

II. 擁塞感知綜合（Congestion-Aware Synthesis）
通過合理分佈單元佈局，緩解擁塞風險，並提升連線可行性。網絡處理器團隊利用 Synopsys Design Compiler 的相關功能，減少佈局擁塞、降低迭代次數、提升整體時序性能。

III. 功耗感知綜合（Power-Aware Synthesis）
面向移動處理器設計，採用多閾值單元（Multi-Vt）與時鐘門控等技術，將電源優化提前合成流程，顯著降低動態與靜態功耗。

IV. 分層物理綜合（Hierarchical Physical Synthesis）
將複雜設計分成多個獨立 Block，分別優化後再集成，有助於提升設計可控性、縮短合成時間，並提高性能準確性。

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